Erik Anzalone
Design and Implementation of efficient low power Hardware accelerators for Deep Learning Neural Networks.
Rel. Guido Masera, Maurizio Martina. Politecnico di Torino, Corso di laurea magistrale in Ingegneria Elettronica (Electronic Engineering), 2019
|
Preview |
PDF (Tesi_di_laurea)
- Tesi
Licenza: Creative Commons Attribution Non-commercial No Derivatives. Download (8MB) | Preview |
![[thumbnail of Documenti_allegati]](https://webthesis.biblio.polito.it/style/images/fileicons/application_zip.png "Documenti_allegati")
|
Archive (ZIP) (Documenti_allegati)
- Altro
Licenza: Creative Commons Attribution Non-commercial No Derivatives. Download (1MB) |
Abstract
Design and Implementation of efficient low power Hardware accelerators for Deep Learning Neural Networks
Relatori
Tipo di pubblicazione
URI
 |
Modifica (riservato agli operatori) |
