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Design and implementation of a hardware accelerator for Deep Convolutional Neural Networks

Osvaldo Genovese

Design and implementation of a hardware accelerator for Deep Convolutional Neural Networks.

Rel. Guido Masera, Maurizio Martina. Politecnico di Torino, Corso di laurea magistrale in Ingegneria Elettronica (Electronic Engineering), 2018

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Abstract:
Relatori: Guido Masera, Maurizio Martina
Anno accademico: 2018/19
Tipo di pubblicazione: Elettronica
Numero di pagine: 63
Soggetti:
Corso di laurea: Corso di laurea magistrale in Ingegneria Elettronica (Electronic Engineering)
Classe di laurea: Nuovo ordinamento > Laurea magistrale > LM-29 - INGEGNERIA ELETTRONICA
Aziende collaboratrici: NON SPECIFICATO
URI: http://webthesis.biblio.polito.it/id/eprint/8468
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